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commit
4998a75ada
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@ -49,11 +49,14 @@ void magic(void) {
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uint32_t ackBox[10];
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uint32_t ackBox[10];
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#define MAX_PAYLOAD 128
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volatile uint8_t data[MAX_PAYLOAD];
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/* maca_rxlen is very important */
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#define command_xcvr_rx() \
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#define command_xcvr_rx() \
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do { \
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do { \
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maca_txlen = (uint32_t)1<<16; \
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maca_txlen = ((0xff)<<16); \
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maca_dmatx = (uint32_t)&ackBox; \
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maca_dmatx = (uint32_t)&ackBox; \
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maca_dmarx = DATA; \
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maca_dmarx = data; \
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maca_tmren = (maca_cpl_clk | maca_soft_clk); \
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maca_tmren = (maca_cpl_clk | maca_soft_clk); \
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maca_control = (control_prm | control_asap | control_seq_rx); \
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maca_control = (control_prm | control_asap | control_seq_rx); \
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}while(FALSE)
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}while(FALSE)
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@ -95,7 +98,6 @@ void main(void) {
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uint8_t c;
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uint8_t c;
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volatile uint32_t i;
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volatile uint32_t i;
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uint32_t tmp;
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uint32_t tmp;
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volatile uint8_t *data;
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uint16_t status;
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uint16_t status;
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*(volatile uint32_t *)GPIO_PAD_DIR0 = 0x00000200;
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*(volatile uint32_t *)GPIO_PAD_DIR0 = 0x00000200;
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||||||
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@ -130,8 +132,7 @@ void main(void) {
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reg(MACA_CONTROL) = SMAC_MACA_CNTL_INIT_STATE;
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reg(MACA_CONTROL) = SMAC_MACA_CNTL_INIT_STATE;
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for(i=0; i<DELAY; i++) { continue; }
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for(i=0; i<DELAY; i++) { continue; }
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data = (void *)DATA;
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reg(MACA_DMARX) = data; /* put data somewhere */
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reg(MACA_DMARX) = DATA; /* put data somewhere */
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reg(MACA_PREAMBLE) = 0;
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reg(MACA_PREAMBLE) = 0;
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/* puts("maca_base\n\r"); */
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/* puts("maca_base\n\r"); */
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@ -149,7 +150,6 @@ void main(void) {
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// puts("\033[H\033[2J");
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// puts("\033[H\033[2J");
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while(1) {
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while(1) {
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uint32_t TsmRxSteps, LastWarmupStep, LastWarmupData, LastWarmdownStep, LastWarmdownData;
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if(_is_action_complete_interrupt(maca_irq)) {
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if(_is_action_complete_interrupt(maca_irq)) {
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maca_clrirq = maca_irq;
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maca_clrirq = maca_irq;
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@ -209,11 +209,14 @@ void main(void) {
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puts(" timestamp: 0x");
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puts(" timestamp: 0x");
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put_hex32(maca_timestamp);
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put_hex32(maca_timestamp);
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puts("\n\r");
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puts("\n\r");
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puts(" data: ");
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puts(" data: 0x");
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for(i=0; i<reg(MACA_GETRXLVL); i++) {
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put_hex32(data);
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putc(' ');
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for(i=0; i<=(reg(MACA_GETRXLVL)-4); i++) { /* fcs+somethingelse is not transferred by DMA */
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put_hex(data[i]);
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put_hex(data[i]);
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putc(' ');
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putc(' ');
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}
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}
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puts("\n\r");
|
puts("\n\r");
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toggle_led();
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toggle_led();
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@ -9,6 +9,9 @@
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#define UART1_CTS 0x80005014
|
#define UART1_CTS 0x80005014
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#define UART1_BR 0x80005018
|
#define UART1_BR 0x80005018
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#define GPIO_PAD_DIR0 0x80000000
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#define GPIO_DATA0 0x80000008
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#include "maca.h"
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#include "maca.h"
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#include "embedded_types.h"
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#include "embedded_types.h"
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@ -17,6 +20,8 @@
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#define DELAY 400000
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#define DELAY 400000
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#define DATA 0x00401000;
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#define DATA 0x00401000;
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#define NL "\033[K\r\n"
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void putc(uint8_t c);
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void putc(uint8_t c);
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void puts(uint8_t *s);
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void puts(uint8_t *s);
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void put_hex(uint8_t x);
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void put_hex(uint8_t x);
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@ -26,12 +31,96 @@ void put_hex32(uint32_t x);
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const uint8_t hex[16]={'0','1','2','3','4','5','6','7',
|
const uint8_t hex[16]={'0','1','2','3','4','5','6','7',
|
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'8','9','a','b','c','d','e','f'};
|
'8','9','a','b','c','d','e','f'};
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void magic(void) {
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#define X 0x80009a000
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#define Y 0x80009a008
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#define VAL 0x0000f7df
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volatile uint32_t x,y;
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x = reg(X); /* get X */
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x &= 0xfffeffff; /* clear bit 16 */
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reg(X) = x; /* put it back */
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y = reg(Y); /* get Y */
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y |= VAL; /* or with the VAL */
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x = reg(X); /* get X again */
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x |= 16; /* or with 16 */
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reg(X) = x; /* put X back */
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reg(Y) = y; /* put Y back */
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}
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uint32_t ackBox[10];
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#define command_xcvr_rx() \
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do { \
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maca_txlen = (uint32_t)1<<16; \
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|
maca_dmatx = (uint32_t)&ackBox; \
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|
maca_dmarx = DATA; \
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||||||
|
maca_tmren = (maca_cpl_clk | maca_soft_clk); \
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||||||
|
maca_control = (control_prm | control_asap | control_seq_rx); \
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}while(FALSE)
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#define PAYLOAD_LEN 16 /* not including the extra 4 bytes for len+fcs+somethingelse */
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/* maca dmatx needs extra 4 bytes for checksum */
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/* needs + 4 bytes for len(1 byte) + fcs(2 bytes) + somethingelse */
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#define command_xcvr_tx() \
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do { \
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maca_txlen = (uint32_t)(PAYLOAD_LEN+4); \
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maca_dmatx = (uint32_t)DATA; \
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||||||
|
maca_dmarx = (uint32_t)&ackBox; \
|
||||||
|
maca_control = (control_prm | control_mode_no_cca | \
|
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control_asap | control_seq_tx); \
|
||||||
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}while(FALSE)
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void dump_regs(uint32_t base, uint32_t len) {
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volatile uint32_t i;
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puts("base +0 +4 +8 +c +10 +14 +18 +1c \n\r");
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for (i = 0; i < len; i ++) {
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if ((i & 7) == 0) {
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put_hex16(4 * i);
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}
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puts(" ");
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put_hex32(reg(base+(4*i)));
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||||||
|
if ((i & 7) == 7)
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puts(NL);
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}
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|
puts(NL);
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|
}
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volatile uint8_t led;
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#define led_on() do { led = 1; reg(GPIO_DATA0) = 0x00000100; } while(0);
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#define led_off() do { led = 0; reg(GPIO_DATA0) = 0x00000000; } while(0);
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void toggle_led(void) {
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if(0 == led) {
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led_on();
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||||||
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led = 1;
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||||||
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} else {
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||||||
|
led_off();
|
||||||
|
}
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||||||
|
}
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||||||
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volatile uint8_t *data;
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uint8_t count=0;
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|
void fill_data(void) {
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|
uint8_t i;
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||||||
|
for(i=0; i<PAYLOAD_LEN; i++) {
|
||||||
|
data[i] = count++;
|
||||||
|
}
|
||||||
|
}
|
||||||
|
|
||||||
__attribute__ ((section ("startup")))
|
__attribute__ ((section ("startup")))
|
||||||
void main(void) {
|
void main(void) {
|
||||||
uint8_t c;
|
uint8_t c;
|
||||||
volatile uint32_t i;
|
volatile uint32_t i;
|
||||||
volatile uint32_t *data;
|
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||||||
uint32_t tmp;
|
uint32_t tmp;
|
||||||
|
uint16_t status;
|
||||||
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||||||
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*(volatile uint32_t *)GPIO_PAD_DIR0 = 0x00000100;
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||||||
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led_on();
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||||||
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||||||
/* Restore UART regs. to default */
|
/* Restore UART regs. to default */
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||||||
/* in case there is still bootloader state leftover */
|
/* in case there is still bootloader state leftover */
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||||||
|
@ -50,54 +139,127 @@ void main(void) {
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||||||
reg(UART1_CON) = 0x00000003; /* enable receive and transmit */
|
reg(UART1_CON) = 0x00000003; /* enable receive and transmit */
|
||||||
reg(GPIO_FUNC_SEL0) = ( (0x01 << (14*2)) | (0x01 << (15*2)) ); /* set GPIO15-14 to UART (UART1 TX and RX)*/
|
reg(GPIO_FUNC_SEL0) = ( (0x01 << (14*2)) | (0x01 << (15*2)) ); /* set GPIO15-14 to UART (UART1 TX and RX)*/
|
||||||
|
|
||||||
reg(80009000) = 0x00050100;
|
reset_maca();
|
||||||
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radio_init();
|
||||||
reg(MACA_RESET) = 0x3; /* reset, turn on the clock */
|
flyback_init();
|
||||||
for(i=0; i<DELAY; i++) { continue; }
|
vreg_init();
|
||||||
reg(MACA_RESET) = 0x2; /* unreset, turn on the clock */
|
|
||||||
for(i=0; i<DELAY; i++) { continue; }
|
|
||||||
|
|
||||||
init_phy();
|
init_phy();
|
||||||
|
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||||||
|
set_power(0x0f); /* 0dbm */
|
||||||
|
set_channel(0); /* channel 11 */
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||||||
reg(MACA_CONTROL) = SMAC_MACA_CNTL_INIT_STATE;
|
reg(MACA_CONTROL) = SMAC_MACA_CNTL_INIT_STATE;
|
||||||
for(i=0; i<DELAY; i++) { continue; }
|
for(i=0; i<DELAY; i++) { continue; }
|
||||||
|
|
||||||
data = (void *)DATA;
|
data = (void *)DATA;
|
||||||
data[0] = 0xabc0ffee;
|
reg(MACA_DMARX) = DATA; /* put data somewhere */
|
||||||
maca_txlen = 1;
|
reg(MACA_PREAMBLE) = 0;
|
||||||
reg(MACA_DMATX) = DATA; /* get data from somewhere */
|
|
||||||
reg(MACA_PREAMBLE) = 0xface0fff;
|
|
||||||
|
|
||||||
|
/* puts("maca_base\n\r"); */
|
||||||
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/* dump_regs(MACA_BASE, 96); */
|
||||||
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/* puts("modem write base\n\r"); */
|
||||||
|
/* dump_regs(0x80009000, 96); */
|
||||||
|
/* puts("modem read base\n\r"); */
|
||||||
|
/* dump_regs(0x800091c0, 96); */
|
||||||
|
/* puts("CRM\n\r"); */
|
||||||
|
/* dump_regs(0x80003000, 96); */
|
||||||
|
/* puts("reserved modem_base\n\r"); */
|
||||||
|
/* dump_regs(0x80009200, 192); */
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||||||
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||||||
#define NL "\033[K\r\n"
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fill_data();
|
||||||
|
command_xcvr_tx();
|
||||||
|
|
||||||
puts("\033[H\033[2J");
|
// puts("\033[H\033[2J");
|
||||||
while(1) {
|
while(1) {
|
||||||
puts("\033[H");
|
|
||||||
puts("rftest-tx --- " NL);
|
|
||||||
|
|
||||||
puts("base +0 +4 +8 +c +10 +14 +18 +1c " NL);
|
if(_is_action_complete_interrupt(maca_irq)) {
|
||||||
for (i = 0; i < 96; i ++) {
|
maca_clrirq = maca_irq;
|
||||||
if ((i & 7) == 0) {
|
|
||||||
put_hex16(4 * i);
|
status = reg(MACA_STATUS) & 0x0000ffff;
|
||||||
|
switch(status)
|
||||||
|
{
|
||||||
|
case(cc_aborted):
|
||||||
|
{
|
||||||
|
puts("aborted\n\r");
|
||||||
|
ResumeMACASync();
|
||||||
|
break;
|
||||||
|
|
||||||
}
|
}
|
||||||
putc(' ');
|
case(cc_not_completed):
|
||||||
put_hex32(reg(MACA_BASE+(4*i)));
|
{
|
||||||
if ((i & 7) == 7)
|
puts("not completed\n\r");
|
||||||
puts(NL);
|
ResumeMACASync();
|
||||||
|
break;
|
||||||
|
|
||||||
|
}
|
||||||
|
case(cc_timeout):
|
||||||
|
{
|
||||||
|
puts("timeout\n\r");
|
||||||
|
ResumeMACASync();
|
||||||
|
break;
|
||||||
|
|
||||||
|
}
|
||||||
|
case(cc_no_ack):
|
||||||
|
{
|
||||||
|
puts("no ack\n\r");
|
||||||
|
ResumeMACASync();
|
||||||
|
break;
|
||||||
|
|
||||||
|
}
|
||||||
|
case(cc_ext_timeout):
|
||||||
|
{
|
||||||
|
puts("ext timeout\n\r");
|
||||||
|
ResumeMACASync();
|
||||||
|
break;
|
||||||
|
|
||||||
|
}
|
||||||
|
case(cc_ext_pnd_timeout):
|
||||||
|
{
|
||||||
|
puts("ext pnd timeout\n\r");
|
||||||
|
ResumeMACASync();
|
||||||
|
break;
|
||||||
|
|
||||||
|
}
|
||||||
|
case(cc_success):
|
||||||
|
{
|
||||||
|
// puts("success\n\r");
|
||||||
|
|
||||||
|
puts("rftest-tx --- " );
|
||||||
|
puts(" payload len+crc: 0x");
|
||||||
|
put_hex(PAYLOAD_LEN+4);
|
||||||
|
puts(" timestamp: 0x");
|
||||||
|
put_hex32(maca_timestamp);
|
||||||
|
puts("\n\r");
|
||||||
|
puts(" data: ");
|
||||||
|
for(i=0; i<PAYLOAD_LEN; i++) {
|
||||||
|
put_hex(data[i]);
|
||||||
|
putc(' ');
|
||||||
|
}
|
||||||
|
puts("\n\r");
|
||||||
|
|
||||||
|
toggle_led();
|
||||||
|
|
||||||
|
fill_data();
|
||||||
|
command_xcvr_tx();
|
||||||
|
|
||||||
|
break;
|
||||||
|
|
||||||
|
}
|
||||||
|
default:
|
||||||
|
{
|
||||||
|
puts("status: ");
|
||||||
|
put_hex16(status);
|
||||||
|
ResumeMACASync();
|
||||||
|
|
||||||
|
}
|
||||||
|
}
|
||||||
|
} else if (_is_filter_failed_interrupt(maca_irq)) {
|
||||||
|
puts("filter failed\n\r");
|
||||||
|
ResumeMACASync();
|
||||||
}
|
}
|
||||||
puts(NL);
|
|
||||||
|
|
||||||
|
|
||||||
/* start a sequence */
|
|
||||||
reg(MACA_CONTROL) = 0x00031A03;
|
|
||||||
/* wait for it to finish */
|
|
||||||
while (((tmp = reg(MACA_STATUS)) & 15) == 14)
|
|
||||||
continue;
|
|
||||||
puts("completed status is ");
|
|
||||||
put_hex32(tmp);
|
|
||||||
puts(NL);
|
|
||||||
for(i=0; i<DELAY; i++) { continue; }
|
for(i=0; i<DELAY; i++) { continue; }
|
||||||
|
|
||||||
};
|
};
|
||||||
}
|
}
|
||||||
|
|
||||||
|
|
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